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2022-11-20
xilinx ISE 默认引脚电平是多少？fpga吧
如图所示，ISE14.7 SPARTAN3系列FPGA，没有指定引脚电平，默认的是LVCMOS25，按理说输...
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2022-11-20
xilinx ISE 默认引脚电平是多少？xilinx吧
如图所示，ISE14.7 SPARTAN3系列FPGA，没有指定引脚电平，默认的是LVCMOS25，按理说输...
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2022-04-07
verilog代码生成的ngc文件为何不能仿真？ise吧
在ISE14.7下用verilog写了一个简单的加法器add.v，前仿真正确，然后封装成了add.ngc（...
2022-04-07
verilog代码生成的ngc文件为何不能仿真？xilinx吧
在ISE14.7下用verilog写了一个简单的加法器add.v，前仿真正确，然后封装成了add.ngc（...
2022-04-07
verilog代码生成的ngc文件为何不能仿真？fpga吧
在ISE14.7下用verilog写了一个简单的加法器add.v，前仿真正确，然后封装成了add.ngc（...
2022-04-06
AD19差分线长度为什么调不了？altium吧
版本Altium Designer19.0.4，用Interactive Differential Pair Routing画完一对差分线...
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2021-10-31
vitis和vitis HLS什么区别？xilinx吧
最近在初学HLS，听说现在新版的开发环境是vitis HLS，可是看了别人的安装程序xilinx文...
2021-10-15
请问用vivado 仿真不能像ISE一样自动生成测试文件框...fpga吧
xilinx的vivado，版本是2019.1 看教程，仿真的时候测试文件test bench竟然要自己一行...
2021-10-15
请问vivado仿真不能像ISE一样自动生成测试文件test ...vivado吧
xilinx的vivado，版本是2019.1 看教程，仿真的时候测试文件test bench竟然要自己一行...
2021-09-22
请问ISE14.7工程目录有些文件为什么突然前面的图标...xilinx吧
RT！ xilinx ISE14.7 win10 64位系统 有时好好的工程有些文件在左侧工程目录下的.v文...
2021-09-20
xilinx下载器驱动的问题，错误代码48，驱动运行被阻...fpga吧
win10 64位系统，ISE14.7安装后无法正确安装下载线驱动，设备管理器里显示感叹号 驱动...
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2021-09-20
xilinx下载器驱动问题，错误代码48，驱动运行被阻止？xilinx吧
win10 64位系统，ISE14.7安装后无法正确安装下载线驱动，设备管理器里显示感叹号 驱动...
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2021-06-24
FPGA普通IO口能做时钟输入管脚么？fpga吧
xilinx SPARTAN3系列 ，PCB只引了一个GC_CLK管脚出来，现在还需要一个时钟，能否用普...
2021-06-05
chipscope出错？fpga吧
软件是ISE14.7，芯片是XC3S50 ChipScope生成cdc文件的时候都没有问题 但是在加载bit文...
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2021-06-05
xilinx FPGA Chipscope如何观测输入管脚的信号？fpga吧
我想用Chipscope观测多个信号，其中包括一个输入IO口（spi_din）， 但是生成下载文件...
2021-04-04
xilinx CAN接口IP核是收费的怎么破？fpga吧
想用xilinx的FPGA上的CAN IP核，结果发现这IP核只能做功能仿真， 没有付费不能固化烧...
2021-04-04
xilinx CAN接口IP核是收费的怎么破？xilinx吧
想用xilinx的FPGA上的CAN IP核，结果发现这IP核只能做功能仿真， 没有付费不能固化烧...
2021-03-03
CCS5.5堆栈的问题？ccs吧
环境：CCS5.5 DSP：TMS320C6748 基于SYSBIOS开发的程序， code memory、data memory、...
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2021-01-22
菜鸟请问CAN总线通信实现方案？fpga吧
自己做的板卡主要基于FPGA工作，现在要与外部设备进行通信，对方留的是CAN接口。 自己...
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2021-01-22
菜鸟请问CAN总线通信实现方案？can总线吧
自己做的板卡主要基于FPGA工作，现在要与外部设备进行通信，对方留的是CAN接口。 自己...
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